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EPM7128STC100-7N - Altera Corporation - famiglia programmabile del dispositivo logico

EPM7128STC100-7N - Altera Corporation - famiglia programmabile del dispositivo logico

EPM7128STC100-7N - Altera Corporation - Programmable Logic Device Family

Dettagli:

Luogo di origine: FILIPPINO
Marca: Altera Corporation
Certificazione: Lead free / RoHS Compliant
Numero di modello: EPM7128STC100-7N

Termini di pagamento e spedizione:

Quantità di ordine minimo: 50
Prezzo: Contact for Sample
Imballaggi particolari: Contatto per il campione
Tempi di consegna: entro 3 giorni
Termini di pagamento: T/T in anticipo, Paypal, Western Union
Capacità di alimentazione: 5000
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Descrizione di prodotto dettagliata

Dettaglio rapido:

 

Famiglia programmabile del dispositivo logico

 

 

Descrizione:

 

La famiglia di max 7000 di PLDs ad alta densità e ad alto rendimento è basata sull'architettura di seconda generazione del max di Altera. Fabbricato con tecnologia CMOS avanzata, alla la famiglia basata EEPROM di max 7000 fornisce 600 - 5.000 portoni utilizzabili, l'ISP, i ritardi del perno--perno velocemente quanto 5 NS e le contro velocità di fino a 175,4 megahertz. I dispositivi di max 7000S in -5, -6, -7 e -10 gradi della velocità come pure dispositivi di max 7000 e di max 7000E nei gradi della velocità di -5, di -6, di -7, di -10P e di -12P aderiscono alla specificazione del bus locale del PCI del gruppo di interesse speciale del PCI (SIG del PCI), la revisione 2,2. Vedi la tabella 3 per i gradi disponibili della velocità.

 

 

Applicazioni:

 

■ ad alto rendimento, a dispositivi logici programmabili basati EEPROM

(PLDs) basato su architettura di seconda generazione di MAX®

programmabilità (ISP) del in-sistema del ■ 5.0-V con l'accessorio

Interfaccia unita di (JTAG) del gruppo di azione della prova di campione 1149,1 di IEEE disponibile dentro

Dispositivi di max 7000S

– Circuiti dell'ISP compatibili con il campione 1532 di IEEE

Il ■ comprende i dispositivi di 5.0-V max 7000 ed ai i dispositivi basati ISP di 5.0-V max 7000S

Circuiti incorporati di (BST) della prova di frontiera-ricerca del ■ JTAG in dispositivi di MAX7000S con 128 o più macrocells

Famiglia completa del ■ EPLD con le densità di logica che variano da 600 a 5.000 portoni utilizzabili (vedi le tabelle 1 e 2)

la logica del perno--perno del ■ 5 NS ritarda con fino alle contro frequenze 175.4-MHz (interconnessione compresa)

dispositivi PCI-compiacenti del ■ disponibili

opzione di uscita dello Aperto scolo del ■ in dispositivi di max 7000S

I flip-flop programmabili del macrocell del ■ con singolo chiaro, il preregolamento, l'orologio e l'orologio permettono ai comandi

Modo programmabile del risparmio di energia del ■ per una riduzione più di 50% di ogni macrocell

Distribuzione configurabile di prodotto-termine dell'estensore del ■, concedendo fino a

32 termini del prodotto per macrocell

i perni dei ■ 44 - 208 disponibili in trasportatore di chip di plastica del J-cavo (PLCC), pin-grid-array ceramico (PGA), flat pack di plastica (PQFP) del quadrato, flat pack del quadrato di potere (RQFP) e 1,0 millimetri assottigliano i pacchetti di (TQFP) del flat pack del quadrato

La sicurezza programmabile del ■ ha morso per la protezione delle progettazioni private

operazione 3.3-V o 5.0-V del ■

– Operazione dell'interfaccia dell'ingresso/uscita di MultiVoltTM, permettendo che i dispositivi colleghino mediante interfaccia 3.3-V o 5.0-V ai dispositivi (l'operazione dell'ingresso/uscita di MultiVolt non è disponibile in 44 pacchetti del perno)

– Pin compatibile con i dispositivi a bassa tensione di max 7000A e di max 7000B

Il ■ ha migliorato le caratteristiche disponibili in dispositivi di max 7000E e di max 7000S

– Sei da uscite guidate da logica o del perno permettono ai segnali

– Due segnali di orologio globali con l'inversione facoltativa

– Risorse migliorate di interconnessione per il routability migliore

– Tempi di messa a punto veloci dell'input forniti da un percorso dedicato dal perno dell'ingresso/uscita ai registri del macrocell

– Controllo programmabile di pantano-rate dell'uscita

Il supporto di progettazione di software del ■ e l'posto-e-itinerario automatico hanno fornito vicino

Sistema di sviluppo di Altera per i pc basati su Windows ed il Sun SPARCstation e HP 9000 serie 700/800 di stazione di lavoro

L'entrata di progettazione del ■ ed il supporto supplementari di simulazione hanno fornito da EDIF

2 0 0 e 3 archivi di 0 0 netlist, biblioteca dei moduli parametrizzati (LPM),

Verilog HDL, VHDL ed altre interfacce agli strumenti popolari di EDA dai produttori quale cadenza, logica dell'esemplare, grafici del mentore,

OrCAD, Synopsys e VeriBest

Supporto di programmazione del ■

– L'unità di programmazione matrice di Altera (MPU) e l'hardware di programmazione dai produttori di terzi programmano tutti

Dispositivi di max 7000

– Il cavo di serie di download del TM dell'artificiere del pezzo, cavo di download del porto parallelo dell'artificiere MVTM di byte e programma max del cavo di download di (USB) di pubblicazione periodica di MasterBlasterTM/Universal Serial Bus

dispositivi 7000S

 

 

Specifiche:

 

Schede

Max 7000

Foto del prodotto

100-TQFP

Imballaggio di serie

270

Categoria

Circuiti integrati (ICs)

Famiglia

Incastonato - CPLDs (dispositivi logici programmabili complessi)

Serie

MAX® 7000S

Imballaggio

Vassoio

Tipo programmabile

Nel sistema programmabile

Tpd di tempo di ritardo (1) massimo

7.5ns

Rifornimento di tensione - interno

4,75 V ~ 5,25 V

Numero degli elementi di logica/blocchi

8

Numero di Macrocells

128

Numero dei portoni

2500

Numero della I /O

84

Temperatura di funzionamento

0°C ~ 70°C

Tipo del montaggio

Supporto di superficie

Pacchetto/caso

100-TQFP

Pacchetto del dispositivo del fornitore

100-TQFP (14x14)

Pagina del catalogo

573 (PDF CN081)

Altri nomi

544-2332

 

 

Vantaggio competitivo:

 

Garanzia: 180 giorni!
Trasporto libero: Ordine oltre la vittoria $1000 una tassa libera della spedizione
(peso delle merci sotto 3Kg), durante il 20130901-20130930.


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