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CY37128P84-100JC - Semiconduttore di Cypress - 5V, 3.3V, ISR™ CPLDs ad alto rendimento

CY37128P84-100JC - Semiconduttore di Cypress - 5V, 3.3V, ISR™ CPLDs ad alto rendimento

CY37128P84-100JC - Cypress Semiconductor - 5V, 3.3V, ISR™ High-Performance CPLDs

Dettagli:

Luogo di origine: FILIPPINO
Marca: Cypress Semiconductor
Certificazione: Lead free / RoHS Compliant
Numero di modello: CY37128P84-100JC

Termini di pagamento e spedizione:

Quantità di ordine minimo: 50
Prezzo: Contact for Sample
Imballaggi particolari: Contatto per il campione
Tempi di consegna: entro 3 giorni
Termini di pagamento: T/T in anticipo, Paypal, Western Union
Capacità di alimentazione: 5000
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Descrizione di prodotto dettagliata

 

Dettaglio rapido:

 

5V, 3.3V, „¢ CPLDs ad alto rendimento di ISRâ

 

 

Descrizione:

 

La famiglia di Ultra37000™ del CMOS CPLDs fornisce ad una gamma di soluzioni programmabili ad alta densità di logica la prestazione di sistema ineguagliabile. La famiglia Ultra37000 è destinata per portare la flessibilità, la facilità d'uso e la prestazione del 22V10 a CPLDs ad alta densità. L'architettura è basata su una serie di blocchetti di logica che sono collegati da una matrice programmabile (PIM) di interconnessione. Ogni blocchetto di logica caratterizza la sua propria matrice di termine del prodotto, il allocator di termine del prodotto e 16 macrocells.

Il PIM distribuisce i segnali dalle uscite del blocchetto di logica e tutti i perni dell'input alla logica bloccano gli input.

Tutti dispositivi Ultra37000 sono elettricamente cancellabili e InSystem riprogrammabili (ISR), che semplifica sia i flussi di fabbricazione che di progettazione, quindi riducenti i costi. La caratteristica di ISR fornisce la capacità di modificare i dispositivi senza avere piedinatura di causa dei cambiamenti di progettazione o cronometrare i cambiamenti. La funzione di Cypress ISR è implementata attraverso un'interfaccia seriale di JTAGcompliant. I dati sono spostati dentro e fuori tramite i perni di TDO e di TDI, rispettivamente. A causa del routability superiore e del modello cronometrante semplice dei dispositivi Ultra37000,

ISR permette che gli utenti cambino le progettazioni attuali di logica mentre simultaneamente ripara la prestazione di sistema di trasferimenti e del mantenimento di piedinatura.

Le intere caratteristiche JTAG della famiglia per ISR e la ricerca di frontiera ed è compatibili con la specificazione del bus locale del PCI, soddisfacente le richieste elettriche e cronometranti. La famiglia Ultra37000 caratterizza le capacità programmabili della bus-tenuta dell'utente su tutto il I/Os.

Dispositivi che di Ultra37000 5.0V i dispositivi Ultra37000 azionano con un rifornimento 5V e che possono sostenere i livelli dell'ingresso/uscita 5V o 3.3V. I collegamenti di VCCO forniscono la capacità di collegamento un bus a 5V o a 3.3V. Collegandosi il VCCO appunta a 5V che l'utente assicura i livelli di 5V TTL sulle uscite. Se VCCO è collegato a 3.3V i livelli d'uscita incontrano i livelli standard di 3.3V JEDEC CMOS e sono 5V tolleranti.

Questi dispositivi richiedono la programmazione di 5V ISR. Dispositivi di Ultra37000V 3.3V

I dispositivi che funzionano con un rifornimento 3.3V richiedono 3.3V su tutti i perni di VCCO, riducenti il consumo di energia del dispositivo. Questi dispositivi sostengono i livelli d'uscita standard di 3.3V JEDEC CMOS e sono 5V-tolerant. Questi dispositivi permettono la programmazione di 3.3V ISR.

 

 

Applicazioni:

 

• In-Sistema Reprogrammable™ (ISR™) CMOS CPLDs

— Interfaccia di JTAG per riconfigurabilità

— I cambiamenti di progettazione non causano i cambiamenti di piedinatura

— I cambiamenti di progettazione non causano i cambiamenti della sincronizzazione

• Ad alta densità

— 32 - 512 macrocells

— 32 - 264 perni dell'ingresso/uscita

— Cinque input dedicati compreso quattro perni dell'orologio

• Modello cronometrante semplice

— Nessun ritardi di uscita

— Nessun ritardi dell'estensore

— Non dedicato contro i ritardi del perno dell'ingresso/uscita

— Nessun ritardo supplementare con PIM

— Nessuna pena per usando in pieno 16 termini del prodotto

— Nessun ritardo per la guida o la divisione dei termini del prodotto

• versioni 3.3V e 5V

• PCI-compatibile [1]

• Capacità programmabili della bus-tenuta su tutto il I/Os

• Il allocator intelligente di termine del prodotto fornisce:

— 0 - 16 termini del prodotto a qualsiasi macrocell

— Termine del prodotto che dirige su base individuale

— Termine del prodotto che divide fra i macrocells locali

• Sincronizzazione flessibile

— Quattro orologi sincroni per dispositivo

— Sincronizzazione di termine del prodotto

— Controllo di polarità dell'orologio per blocchetto di logica

• Pacchetto/piedinatura coerenti che offre attraverso tutte le densità

— Semplifica la migrazione di progettazione

— La stessa piedinatura per i dispositivi 3.3V e 5.0V

• Pacchetti

— 44 - 400 cavi in PLCC, CLCC, PQFP, TQFP, CQFP, BGA e pacchetti del Fine-Passo BGA

 

 

Specifiche:

 

numero del pezzo.

CY37128P84-100JC

Produttore

Semiconduttore di Cypress

abilità del rifornimento

10000

datecode

10+

pacchetto

BGA

osservazione

nuove ed azione originali

 

 

Vantaggio competitivo:

 

Garanzia: 180 giorni!
Trasporto libero: Ordine oltre la vittoria $1000 una tassa libera della spedizione
(peso delle merci sotto 3Kg), durante il 20130901-20130930.


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