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Xilinx programmabile del chip XC9536XL-10VQG64C- di IC - famiglia ad alto rendimento di XC9500XL CPLD

Xilinx programmabile del chip XC9536XL-10VQG64C- di IC - famiglia ad alto rendimento di XC9500XL CPLD

Programmable IC Chip XC9536XL-10VQG64C- xilinx - XC9500XL High-Performance CPLD Family

Dettagli:

Luogo di origine: FILIPPINO
Marca: xilinx
Certificazione: Lead free / RoHS Compliant
Numero di modello: XC9536XL-10VQG64C

Termini di pagamento e spedizione:

Quantità di ordine minimo: 50
Prezzo: Contact for Sample
Imballaggi particolari: Contatto per il campione
Tempi di consegna: entro 3 giorni
Termini di pagamento: T/T in anticipo, Paypal, Western Union
Capacità di alimentazione: 5000
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Descrizione di prodotto dettagliata


Dettaglio rapido:
Famiglia ad alto rendimento di XC9500XL CPLD
Descrizione:
La famiglia di FastFLASH XC9500XL è una famiglia di 3.3V CPLD mirata a per le applicazioni ad alto rendimento e a bassa tensione nelle comunicazioni avanzate ed i sistemi informatici, in cui l'alta dissipazione dell'affidabilità e di potere basso del dispositivo è importante. Ogni in-sistema di sostegni del dispositivo di XC9500XL che programma (ISP) e la frontiera-ricerca completa di IEEE lo Std 1149,1 (JTAG), permettendo il superiore mette a punto e progetta la capacità della ripetizione per i piccoli pacchetti di fattore forma. La famiglia di XC9500XL è destinata per lavorare molto attentamente con le famiglie di Xilinx® Virtex®, di Spartan®-XL e di XC4000XL FPGA, permettendo che gli analisti programmatori dividano ottimamente la logica fra i circuiti veloci dell'interfaccia e la logica per tutti gli usi ad alta densità. Secondo le indicazioni della tabella 1, la densità di logica dei dispositivi di XC9500XL varia da 800 a 6400 portoni utilizzabili con 36 - 288 registri, rispettivamente. Le opzioni multiple del pacchetto e la capacità collegata dell'ingresso/uscita sono indicate in tabella 2. I membri della famiglia di XC9500XL sono completamente perno-compatibili, permettendo la migrazione facile di progettazione attraverso le opzioni multiple di densità in un'orma data del pacchetto.
Le caratteristiche architettoniche di XC9500XL indirizzano i requisiti della programmabilità del in-sistema. Migliorato perno-chiudere la capacità a chiave evita la ripresa costosa del bordo. il In-sistema che programmano in tutto il raggio d'azione commerciale completo e un'alta valutazione di programmazione di resistenza forniscono le riconfigurazioni senza problemi delle modifiche dopo l'installazione del sistema. La conservazione estesa di dati sostiene la durata di funzionamento più lunga e più affidabile del sistema.
Le caratteristiche del sistema avanzate includono il controllo di tasso di pantano dell'uscita ed i perni a terra utente-programmabili per contribuire a ridurre il rumore del sistema. Ogni perno dell'utente è compatibile con gli input 5V, 3.3V e 2.5V e le uscite possono essere configurate per l'operazione 3.3V o 2.5V. L'oscillazione completa simmetrica di tensione in uscita 3.3V delle mostre del dispositivo di XC9500XL per concedere aumento ed i tempi di caduta equilibrati.
Applicazioni:
• Ottimizzato per i sistemi ad alto rendimento 3.3V
- 5 ritardi di logica del perno--perno di NS, con frequenza del sistema interno fino a 208 megahertz
- Piccoli pacchetti di orma compreso VQFPs, TQFPs e CSPs (pacchetto della scaglia della patata fritta)
- disponibile senza Pb per tutti i pacchetti
- Funzionamento a potenza più basso
- i perni tolleranti dell'ingresso/uscita 5V accettano i segnali 5V, 3.3V e 2.5V
- capacità dell'uscita 3.3V o 2.5V
- Tecnologia avanzata di CMOS FastFLASH di feature size di 0,35 micron
• Caratteristiche del sistema avanzate
- In-sistema programmabile
- Perno-chiusura e routability superiori con la matrice di commutatore di FastCONNECT II
- Extra largamente 54 blocchi funzionali introdotti
- Fino a 90 prodotto-termini per macrocell con la singola assegnazione di prodotto-termine
- Inversione dell'orologio locale con tre orologi prodotto-termine di un e globali
- La singola uscita permette a per di produrre il perno con l'inversione locale
- Introduca l'isteresi su tutti gli input del perno di frontiera-ricerca e dell'utente
- circuiti della Bus-tenuta su tutti gli input del perno dell'utente
- Supporti chetappano capacità
- Supporto completo di frontiera-ricerca di IEEE Std 1149,1 (JTAG) su tutti i dispositivi
• Quattro densità perno-compatibili del dispositivo
- 36 - 288 macrocells, con 800 - 6400 portoni utilizzabili
• Programmazione concorrente veloce
• Controllo di tasso di pantano sulle diverse uscite
• Funzioni di sicurezza migliorate di dati
• Qualità ed affidabilità eccellenti
- 10.000 programmi/erase ciclano la valutazione di resistenza
- una conservazione di 20 dati di anno
• Pin-compatibile con 5V le orme in comune del pacchetto della famiglia del centro XC9500
Specifiche:

Schede

XC9536XL

Foto del prodotto

XC9536XL-10VQG64C

Imballaggio di serie

160

Categoria

Circuiti integrati (ICs)

Famiglia

Incastonato - CPLDs (dispositivi logici programmabili complessi)

Serie

XC9500XL

Imballaggio

Vassoio

Tipo programmabile

Nel sistema programmabile (cicli minimi di programma 10K/erase)

Tpd di tempo di ritardo (1) massimo

10.0ns

Rifornimento di tensione - interno

3 V ~ 3,6 V

Numero degli elementi di logica/blocchi

2

Numero di Macrocells

36

Numero dei portoni

800

Numero della I /O

36

Temperatura di funzionamento

0°C ~ 70°C

Tipo del montaggio

Supporto di superficie

Pacchetto/caso

64-TQFP

Pacchetto del dispositivo del fornitore

64-VQFP (10x10)

Pagina del catalogo

565 (PDF CN081)

Altri nomi

122-1435
XC9536XL10VQG64C


Vantaggio competitivo:
Garanzia: 180 giorni!
Trasporto libero: Ordine oltre la vittoria $1000 una tassa libera della spedizione
(peso delle merci sotto 3Kg), durante il 20130901-20130930.
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